计算机系统组成与体系结构

基本信息:
出版社:人民邮电出版社
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版次:1
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页数:409
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装帧:平装
纸张:胶版纸
正文语种:

内容简介:
　　《计算机系统组成与体系结构》详述了有关计算机及其子系统设计的基本概念及相关知识。全书由三大部分组成：第一部分是数字逻辑和有限状态机，介绍了布尔代数基础、数字部件、组合逻辑和顺序逻辑、可编程逻辑器件。有限状态机是全书的基础。第二部分是计算机组成和系统结构，内容包括指令集系统结构、计算机组成、寄存器传输语言、CPU设计、控制部件设计、算术运算、存储器结构、I/O结构。第三部分是高级专题，内容包括RISC计算机和并行处理。　　《计算机系统组成与体系结构》内容适度、可读性好、实用性强，适合作为计算机工程、计算机科学、电子工程、信息系统等专业的计算机体系结构课程的教材。·查看全部>>

目录:
第一部分 数字逻辑与有限状态机第1章 数字逻辑基础　31.1 布尔代数　31.1.1 基本函数　41.1.2 布尔函数的使用　51.2 基本的组合逻辑　91.3 更复杂的组合件　111.3.1 多路选择器　111.3.2 译码器　131.3.3 编码器　141.3.4 比较器　161.3.5 加法器和减法器　181.3.6 存储器　201.4 组合电路设计　211.4.1 BCD码的7段译码器　221.4.2 数据排序器　241.5 基本时序件　251.6 更复杂的时序件　281.6.1 计数器　281.6.2 移位寄存器　301.7 实例：可编程逻辑设备　311.8 总结　331.9 习题　34第2章 介绍有限状态机　372.1 状态图和状态表　382.2 Mealy机和Moore机　412.3 设计状态图　412.3.1 模6计数器　422.3.2 串检查器　432.3.3 收费站控制器　442.4 从状态图到实现　482.4.1 状态赋值　492.4.2 Mealy机和Moore机的实现　502.4.3 产生次态　512.4.4 产生系统输出　552.4.5 一种可替代的设计　582.4.6 八状态串检查器　592.5 实例：实际考虑　612.5.1 未使用状态　612.5.2 异步设计　632.5.3 状态机转换　662.6 总结　672.7 习题　68第二部分 计算机组成与体系结构第3章 指令集结构　753.1 程序设计语言的级别　763.1.1 语言种类　763.1.2 编译和汇编程序　763.2 汇编语言指令　793.2.1 指令类型　803.2.2 数据类型　813.2.3 寻址方式　823.2.4 指令格式　843.3 指令集结构设计　863.4 相对简单的指令集结构　873.5 实例：8085微处理器指令集结构　923.5.1 8085微处理器的寄存器组　923.5.2 8085微处理器指令集　933.5.3 一个简单的8085程序　973.5.4 分析8085指令集结构　983.6 总结　993.7 习题　99第4章 介绍计算机组成　1024.1 基本的计算机组成　1024.1.1 系统总线　1034.1.2 指令周期　1044.2 CPU组成　1064.3 存储器子系统组成和接口　1074.3.1 存储器的种类　1074.3.2 芯片内部组成　1094.3.3 存储器子系统配置　1104.3.4 多字节数据组成　1144.3.5 基本功能的拓展　1154.4 I/O子系统组成和接口　1154.5 相对简单计算机　1174.6 实例：一台基于8085的计算机　1204.7 总结　1234.8 习题　124第5章 寄存器传送语言　1265.1 微操作和寄存器传送语言　1275.2 用RTL描述数字系统　1325.2.1 数字件　1325.2.2 简单系统的描述与实现　1335.3 更复杂的数字系统和RTL　1365.3.1 模6计数器　1375.3.2 收费站控制器　1395.4 实例：VHDL－VHSIC硬件描述语言　1435.4.1 VHDL语法　1445.4.2 高层抽象的VHDL设计　1465.4.3 低层抽象的VHDL设计　1495.5 总结　1515.6 习题　151第6章 CPU设计　1546.1 CPU的设计规范　1546.2 非常简单CPU的设计与实现　1556.2.1 非常简单CPU的设计规范　1556.2.2 从存储器中取指令　1566.2.3 指令译码　1576.2.4 指令执行　1586.2.5 建立所需的数据通路　1606.2.6 非常简单ALU的设计　1636.2.7 用硬连线控制设计控制单　1646.2.8 设计验证　1686.3 相对简单CPU的设计和实现　1696.3.1 相对简单CPU的规范　1696.3.2 取指令和指令译码　1716.3.3 执行指令　1726.3.4 创建数据通路　1766.3.5 相对简单ALU的设计　1796.3.6 用硬连线控制设计控制单　1816.3.7 设计验证　1836.4 简单CPU的缺点　1836.4.1 更多的内部寄存器和高速缓存　1836.4.2 CPU内部的多总线　1846.4.3 指令流水线式处理　1856.4.4 更大的指令集　1866.4.5 子程序和中断　1876.5 实例：8085微处理器的内部结构　1876.6 总结　1896.7 习题　189第7章 微序列控制单设计　1947.1 微序列控制器设计基础　1947.1.1 微序列控制器的操作　1947.1.2 微指令格式　1967.2 非常简单微序列控制器的设计和实现　1977.2.1 基本布局　1977.2.2 生成正确序列并设计映象逻辑　1987.2.3 用水平微代码生成微操作　1997.2.4 用垂直微代码生成微操作　2017.2.5 从微代码直接产生控制信号　2057.3 相对简单微序列控制器的设计和实现　2067.3.1 修改状态图　2067.3.2 设计顺序硬件和微代码　2077.3.3 用水平微代码完成设计　2107.4 减少微指令数　2127.4.1 微子程序　2127.4.2 微代码跳转　2157.5 微程序控制和硬连线控制的比较　2167.5.1 指令集的复杂度　2177.5.2 修改的容易度　2177.5.3 时钟速度　2177.6 实例：一个（大部分是）微代码的CPU：奔腾微处理器　2177.7 总结　2197.8 习题　219第8章 运算方法　2228.1 无符号表示法　2238.1.1 加法和减法　2238.1.2 乘法　2268.1.3 除法　2348.2 带符号表示法　2418.2.1 符号幅值表示法　2428.2.2 符号补码表示法　2468.3 BCD码（binary coded decimal）　2468.3.1 BCD码的格式　2478.3.2 加法和减法　2478.3.3 乘法和除法　2518.4 专用运算部件　2528.4.1 流水线　2538.4.2 查找表　2558.4.3 华莱士树　2568.5 浮点数　2598.5.1 数据格式　2608.5.2 数据性质　2608.5.3 加法和减法　2628.5.4 乘法和除法　2658.6 实例：IEEE 754 浮点标准　2678.6.1 格式　2688.6.2 锋范数　2698.7 总结　2698.8 习题　270第9章 存储器结构　2739.1 存储器的层次结构　2739.2 cache存储器　2749.2.1 相联存储器　2749.2.2 相联映象的cache存储器　2769.2.3 直接映象的cache存储器　2789.2.4 组相联映象的cache存储器　2799.2.5 在cache中替换数据　2819.2.6 写数据到cache　2839.2.7 cache的性能　2849.3 虚拟存储器　2879.3.1 分页　2889.3.2 分段　2949.3.3 存储保护　2969.4 基本cache和虚拟存储器的扩展　2979.4.1 基本cache的扩展　2979.4.2 基本虚拟存储器的扩展　2989.5 实例：Pentium/Windows个人计算机上的内存管理　2999.6 总结　3009.7 习题　300第10章 输入输出结构　30510.1 异步数据传输　30510.1.1 源启动的数据传送　30610.1.2 目的启动的数据传送　30710.1.3 握手　30810.2 可编程I/O　30910.2.1 新指令　31310.2.2 新控制信号　31310.2.3 新状态和RTL代码　31310.2.4 修改CPU硬件以支持新指令　31410.2.5 确保其他指令正常工作　31510.3 中断　31510.3.1 CPU和I/O设备之间的数据传送　31510.3.2 中断类型　31710.3.3 中断处理　31710.3.4 中断硬件和优先级　31910.3.5 CPU内部中断实现　32310.4 直接存储器访问　32510.4.1 将直接存储器访问（DMA）纳入计算机系统　32510.4.2 DMA传输方式　32710.4.3 修改CPU输与DMA共处　32810.5 I/O处理器　32910.6 串行通信　33210.6.1 串行通信原理　33210.6.2 通用异步收发器（UART）　33410.7 实例：串行通信标准　33610.7.1 RS-232-C标准　33610.7.2 通用串行总线标准　33710.8 总结　33810.9 习题　339第三部分 高级专题第11章 精简指令集计算　34511.1 RISC基本原理　34511.1.1 定长指令　34611.1.2 只有LOAD和STORE的指令访问存储器　34611.1.3 较少的寻址方式　34611.1.4 指令流水线　34611.1.5 大量的寄存器　34711.1.6 硬连线控制单　34711.1.7 延时载入和分支　34711.1.8 指令的预测执行　34711.1.9 优化编译器　34811.1.10 分离指令和数据流　34811.2 RISC指令集　34811.3 指令流水线和寄存器窗口　35011.3.1 指令流水线　35011.3.2 寄存器窗口和重命名　35311.4 指令流水线冲突　35611.4.1 数据冲突　35611.4.2 分支冲突　35911.5 RISC与CISC的比较　36311.6 实例：Itanium微处理器　36311.7 小结　36511.8 习题　366第12章 介绍并行处理　36912.1 单处理机系统中的并行机制　36912.2 多处理机系统的组织结构　37212.2.1 弗林分类法　37212.2.2 系统拓扑结构　37312.2.3 MIMD系统的体系结构　37512.3 多处理机系统中的通信　37812.3.1 固定连接　37912.3.2 可重构连接　38012.3.3 多级互连网络（MIN）的路由　38412.4 多处理机系统中的存储器管理　38812.4.1 共享存储器　38812.4.2 Cache一致性　39012.5 多处理机操作系统和软件　39312.6 并行算法　39412.6.1 并行冒泡排序　39512.6.2 并行矩阵乘法　39612.7 其他的并行体系结构　39912.7.1 数据流计算　39912.7.2 脉动阵列　40312.7.3 神经网络　40612.8 小结　40612.9 习题　407·查看全部>>信息反馈：如果您发现商品信息或者图片不准确，欢迎更新。 全部评价 很喜欢 一般 不喜欢正在加载中，请稍候... 正在加载中，请稍候... 正在加载中，请稍候... 正在加载中，请稍候...所有咨询信息 网友讨论圈 晒单帖 讨论帖 问答帖 圈子帖正在加载中，请稍候... 正在加载中，请稍候... 正在加载中，请稍候... 正在加载中，请稍候... 正在加载中，请稍候...

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